Firmware - Novembre 2014 / N°106 - (Page 20)
INSIDE
DESCRIZIONE DELLO SCHEMA A BLOCCHI
In figura1 possiamo vedere lo schema
a blocchi del SoC, veramente completo
e complesso. Possiamo distinguere cinque blocchi circuitali principali ed una
serie di moduli di servizio.
Procedendo da sinistra a destra, troviamo
il modulo CIP51, principalmente formato
dalla CPU, un microcontrollore della famiglia 8051, su cui ritorneremo tra poco.
Il modulo contiene anche memoria programma, fino a 64 kB of flash e memoria
dati, fino a 4 kB di RAM.
La memoria FLASH è in realtà usabile
anche per conservare dati attraverso un
meccanismo che vedremo in seguito,
meccanismo che costituisce un'eccezione nell'architettura di CIP51.
Troviamo poi gli Special Function Registers, sostanzialmente un banco di memoria RAM con flessibili meccanismi di
accesso. Il modo d'indirizzamento diretto
è usato per accedere agli SFR, molti sono
anche bit-addressable, oltre che byte-addressable.
L'indirizzamento diretto, ricordiamo brevemente, specifica l'operando esprimendo direttamente il suo indirizzo in memoria, come numero esadecimale o, meglio,
con un nome mnemonico abbreviato (ad
esempio P3 per Port3 Data Register).
Il modulo SFR contiene sia i registri standard dell'architettura 8051 che registri aggiunti per gestire le periferiche proprie di
Si10x. Gli SFR gestiscono anche lo scambio dati tra CPU e periferiche on-chip.
Abbiamo poi un blocco Periferiche Digitali ed un blocco Periferiche Analogiche.
Il blocco digitale contiene i quattro counter/timer classici dell'architettura MCS51,
una interfaccia seriale UART, una interfaccia seriale SPI, una interfaccia seriale
I2C, 11 General Purpose I/O (GPIO).
Il modulo di gestione hardware della periferica I2C è compatibile con la System
Management Bus Specification, versione 1.1. È interessante notare come la SPI
possa essere usata internamente al chip
in uno dei due modi di interfacciamento
con il modulo RF RTX, nel qual caso essa
è sempre attiva. Il lettore che non abbia
familiarità con SPI può trovare una introduzione a questa interfaccia in rif. 3.
Il modulo digitale diSi106 contiene anche
una periferica timer avanzata, simile a
quanto reso disponibile da Intel sui suoi
ultimi dispositivi MCS-52, il Programmable Counter Array.
Esso consiste in counter/timer con funzioni avanzate richiedenti minore supervisione da parte della CPU, confrontati
con i timer base dell'architettura.
Il PCA consiste in un counter/timer 16-bit
aggiuntivo e sei moduli capture/compare.
Ogni modulo capture/compare ha la propria linea hardware associata con un I/O
fisico connesso alla Crossbar, in modo
da potergli assegnare un pin fisico, se richiesto. PCA consente cosi di realizzare
funzioni di misura di intervalli di tempo e
generazione di treni di impulsi PWM con
minima perdita di tempo CPU.
http://www.pcb-pool.com/ppit/index.html
http://www.beta-estore.com/rkit/index.html
Tabella dei contenuti per la edizione digitale del Firmware - Novembre 2014 / N°106
SOMMARIO
FOCUS on “Don’t try this at home”
Skills Accesso e controllo remoto RF
INside
I motori Brushless DC
Silicon Labs Si106x-108x: MCU con Wireless Sub-Giga ad Alte Prestazioni
ANALOG Alimentatore DC da Banco ad Alte Prestazioni
SPOTlight Carica, Scarica e Bilanciamento dei Supercondensatori
Tools
“Low Cost Controllerless” con PIC32
Code Composer Studio: il Ruolo degli Script nello Sviluppo del Codice
Linear Technology “PowerCAD II” La Progettazione Assistita dei Convertitori DC/DC
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