Firmware - Luglio-Agosto 2014 / N°102/103 - (Page 46)

Analog E non abbiamo finito perché il tempo di propagazione all'interno delle connessioni rappresenta un potenziale collo di bottiglia e per stimarlo dobbiamo utilizzare la formula: La massima frequenza di dithering non dovrebbe mai superare il valore di F1 e/o F2 e pertanto possiamo dire che deve essere inferiore al più piccolo dei due valori. Fatto questo va necessariamente calcolato il rapporto fOSC/fDITHER che dovrà essere approssimato al più vicino multiplo di due rispetto al valore calcolato. Fatto questo, resta da determinare la capacità di carico che rappresenta il più piccolo valore di capacità di disaccoppiamento che si possa tollerare, noto che sia il valore di resistenza delle connessioni: NB: come sempre, non possiamo prescindere dai valori commercialmente disponibili per le capacità che, come sappiamo, sono discreti. Proprio per questo motivo, sarà assolutamente indispensabile confrontare questo valore col più vicino disponibile ed eventualmente ricontrollare questi stessi conti al fine di ottenere valori che meglio si avvicinino a quelli richiesti. IN CONCLUSIONE Quello di cui abbiamo parlato è un sistema di controllo e di retroazione che serve a garantire la maggiore e più sicura misurazione di tutte le componenti di errore relative alla tensione effettivamente disponibile sul carico quando ci si renda conto che esso non riceve il valore di potenza desiderato. Tale tecnica risulta utile anche per un controllo a posteriori e non già per il "solo" progetto. E se da un lato l'isolamento ottico propone notevoli vantaggi, dall'altro un controllo più preciso è possibile anche utilizzando configurazioni cascode che sfruttino transistor mosfet attraverso il pilotaggio della tensione posta in ingresso a quest'ultimo. Figura 18: Esempio di controllo CASCODE Tutto questo, una volta confrontato con i valori tipici e caratteristici della compensazione, restituisce un sistema affidabile e stabile nel tempo. 2-Wire Virtual Remote Sensing for Voltage Regulators - www.linear.com/docs/30159 Figura 19: Tipico diagramma di flusso dell'iter progettuale FOCUS ON SKILLS INSIDE TOOLS ANALOG TIPS'N TRICKS MARKET NEWS SPOTLIGHT EVENTS ZAPPING MEMBERSHIP http://www.linear.com/docs/30159 http://www.fwonline.it/fw/?page_id=7

Tabella dei contenuti per la edizione digitale del Firmware - Luglio-Agosto 2014 / N°102/103

TIPS'n tricks
FOCUS on Triplo DES con Microchip
SKILLs Delay/Block Debouncer
INside
Una Soluzione ZigBee a Singolo Chip
La famiglia XMEGA e gli ADC di Atmel
ANALOG “Sensing” Virtuale a 2-Fili per Regolatori di Tensione
SPOTlight
Proteggere gli Investimenti in R&D con l’Autenticazione Sicura
Vivado High-Level Synthesis
Il CMRR negli Operazionali ad Ampia Gamma Dinamica
News
EVENTS zapping
Guida

Firmware - Luglio-Agosto 2014 / N°102/103

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